cpld时序测试,信号完整性测试

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portant;">一般带显示控制器的MCU价格比较高,且驱动较大显示分辨率的液晶屏需要的显存较大,所以很多人采用CPLD(FPGA)+SDRAM用来取代显示控制器,从而MCU的选择范围可以更大。本文介绍了此种设计的部分内容。

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portant;">图1 硬件设计框图

portant;">首先重要的接口是LCD接口,需要严格按照LCD操作时序输出行场扫描,数据使能信号。

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portant;">图2 液晶显示屏数据和使能时序图

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portant;">图3 液晶显示屏行场扫描时序图

portant;">接下来是要设计SDRAM控制器,用于存储需要显示的画面。SDRAM控制器网络上很多文章专门介绍如何设计。一般设计包括两部分,分别是SDRAM的初始化和SDRAM正常操作部分两个状态机。

portant;">SDRAM初始化操作包括不小于6次的自刷新,然后载入配置寄存器。SDRAM正常操作包括对读写请求的执行,以及定期的自刷新操作。一般设计的时候需要下载SDRAM仿真模型,用于验证操作时序是否符合要求。

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portant;">图4 仿真SDRAM初始化操作打印结果

portant;">另外还要设计与MCU的接口,MCU接口大部分采用英特尔8080模式和摩托罗拉6800模式,其中8080模式采用数据总线(DB)、数据/指令选择(D/I)、片选(CS)、读使能(WR)、写使能(RD);6800模式采用用数据总线(DB)、数据/指令选择(D/I)、片选(CS)、读写选择(RD/WR)。

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发布时间
2023-12-15 12:51
所属行业
电子产品检测
编号
40724919
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